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Lattice Semiconductor
10Gb Ethernet XGXS IP Core User’s Guide
Table 11. XGMII Related I/Os (Continued)
Signal
Pin
Direction
Buffer
xgmii_tx_data_5
D19
input
HSTL1
xgmii_tx_data_6
E19
input
HSTL1
xgmii_tx_data_7
E18
input
HSTL1
xgmii_tx_data_9
C20
input
HSTL1
xgmii_rx_data_0
AL18
output
HSTL1
xgmii_rx_data_1
AN21
output
HSTL1
xgmii_rx_data_10
AN25
output
HSTL1
xgmii_rx_data_11
AL22
output
HSTL1
xgmii_rx_data_12
AL23
output
HSTL1
xgmii_rx_data_13
AN27
output
HSTL1
xgmii_rx_data_14
AM25
output
HSTL1
xgmii_rx_data_15
AP29
output
HSTL1
xgmii_rx_data_16
AN29
output
HSTL1
xgmii_rx_data_17
AN28
output
HSTL1
xgmii_rx_data_18
AM26
output
HSTL1
xgmii_rx_data_19
AK23
output
HSTL1
xgmii_rx_data_2
AM21
output
HSTL1
xgmii_rx_data_20
AL25
output
HSTL1
xgmii_rx_data_21
AP31
output
HSTL1
xgmii_rx_data_22
AK24
output
HSTL1
xgmii_rx_data_23
AM28
output
HSTL1
xgmii_rx_data_24
AN30
output
HSTL1
xgmii_rx_data_25
AL26
output
HSTL1
xgmii_rx_data_26
AL28
output
HSTL1
xgmii_rx_data_27
AN31
output
HSTL1
xgmii_rx_data_28
AK26
output
HSTL1
xgmii_rx_data_29
AM30
output
HSTL1
xgmii_rx_data_3
AN22
output
HSTL1
xgmii_rx_data_30
AL29
output
HSTL1
xgmii_rx_data_31
AK27
output
HSTL1
xgmii_rx_data_4
AK18
output
HSTL1
xgmii_rx_data_5
AN23
output
HSTL1
xgmii_rx_data_6
AP26
output
HSTL1
xgmii_rx_data_7
AK19
output
HSTL1
xgmii_rx_data_8
AL21
output
HSTL1
xgmii_rx_data_9
AM23
output
HSTL1
xgmii_rxclk_156
AN18
input
HSTL1
xgmii_rxclk_156_out
AN19
output
HSTL1
xgmii_txclk_156
A23
input
HSTL1
24
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